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Extrait du Registre européen des brevets

EP Présentation générale: EP1246121

EP1246121 - Circuit dynamiquement reconfigurable de traitement du signal, appareil de reconnaissance des formes et appareil de traitement des images [Cliquez sur ce lien avec le bouton droit de la souris pour le conserver dans vos signets]
StatutAucune opposition formée dans le délai
Statut actualisé le  25.10.2013
Base de données mise à jour au 28.09.2024
Dernier événement   Tooltip13.12.2013Extinction du brevet dans un Etat contractant
Nouvel/nouveaux État(s): IT
publié le 15.01.2014  [2014/03]
Demandeur(s)Pour tous les Etats désignés
CANON KABUSHIKI KAISHA
3-30-2, Shimomaruko, Ohta-ku
Tokyo / JP
[2012/51]
Précédent [2002/40]Pour tous les Etats désignés
CANON KABUSHIKI KAISHA
3-30-2 Shimomaruko
Ohta-ku, Tokyo / JP
Inventeur(s)01 / Matsugu, Masakazu
Canon Kabushiki Kaisha
30-2, Shimomaruko 3-chome
Ohta-ku, Tokyo / JP
02 / Mori, Katsuhiko
Canon Kabushiki Kaisha
30-2, Shimomaruko 3-chome
Ohta-ku, Tokyo / JP
03 / Nomura, Osamu
Canon Kabushiki Kaisha
30-2, Shimomaruko 3-chome
Ohta-ku, Tokyo / JP
 [2012/51]
Précédent [2002/40]01 / Matsugu, Masakazu
Canon Kabushiki Kaisha, 30-2, Shimomaruko 3-chome
Ohta-ku, Tokyo / JP
02 / Mori, Katsuhiko
Canon Kabushiki Kaisha, 30-2, Shimomaruko 3-chome
Ohta-ku, Tokyo / JP
03 / Nomura, Osamu
Canon Kabushiki Kaisha, 30-2, Shimomaruko 3-chome
Ohta-ku, Tokyo / JP
Mandataire(s)Hitching, Peter Matthew, et al
Canon Europe Ltd
European Patent Department
3 The Square
Stockley Park
Uxbridge Middlesex UB11 1ET / GB
[N/P]
Précédent [2012/51]Hitching, Peter Matthew, et al
Canon Europe Ltd 3 The Square Stockley Park Uxbridge Middlesex
UB11 1ET / GB
Précédent [2008/41]Hitching, Peter Matthew, et al
Canon Europe Limited 6 Roundwood Avenue Stockley Park Uxbridge
UB11 1JA / GB
Précédent [2008/24]Hitching, Peter Matthew, et al
Canon Europe Ltd. European Patent Department 6 Roundwood Avenue Stockley Park
Middlesex, Uxbridge UB11 1JA / GB
Précédent [2002/40]Beresford, Keith Denis Lewis, et al
BERESFORD & Co. 2-5 Warwick Court, High Holborn
London WC1R 5DH / GB
Numéro de la demande, date de dépôt02252197.527.03.2002
[2002/40]
Numéro de priorité, dateJP2001009327428.03.2001         Format original publié: JP 2001093274
JP2001016451031.05.2001         Format original publié: JP 2001164510
JP2001016428231.05.2001         Format original publié: JP 2001164282
JP2001027255707.09.2001         Format original publié: JP 2001272557
JP2001027255507.09.2001         Format original publié: JP 2001272555
[2002/40]
Langue de dépôtEN
Langue de la procédureEN
PublicationType: A2 Demande sans rapport de recherche 
N°:EP1246121
Date:02.10.2002
Langue:EN
[2002/40]
Type: A3 Rapport de recherche 
N°:EP1246121
Date:10.10.2007
[2007/41]
Type: B1 Fascicule de brevet 
N°:EP1246121
Date:19.12.2012
Langue:EN
[2012/51]
Rapport(s) de rechercheRapport (complémentaire) de recherche européenne - envoyé le:EP11.09.2007
ClassificationIPC:G06K9/46, G06K9/00
[2012/31]
CPC:
G06V40/171 (EP,US); G06V10/454 (EP,US); G06V10/94 (EP,US);
G06N3/049 (EP,US); G06N3/063 (EP,US)
Précédent IPC [2002/40]G06K9/00
Etats contractants désignésDE,   FR,   GB,   IT,   NL [2008/25]
Précédent [2002/40]AT,  BE,  CH,  CY,  DE,  DK,  ES,  FI,  FR,  GB,  GR,  IE,  IT,  LI,  LU,  MC,  NL,  PT,  SE,  TR 
TitreAllemand:Dynamisch rekonfigurierbare Schaltung zur Signalverarbeitung, Gerät zur Mustererkennung und Gerät zur Bildverarbeitung[2002/40]
Anglais:Dynamically reconfigurable signal processing circuit, pattern recognition apparatus, and image processing apparatus[2002/40]
Français:Circuit dynamiquement reconfigurable de traitement du signal, appareil de reconnaissance des formes et appareil de traitement des images[2002/40]
Procédure d'examen10.04.2008Requête en examen déposée  [2008/22]
11.04.2008Perte de droit, date d'effet juridique: Etat(s) désigné(s)
09.06.2008Envoi de la notification relative à une perte de droit : Etat(s) désigné(s) AT, BE, CH, CY, DK, ES, FI, GR, IE, LU, MC, PT, SE, TR
11.01.2010Envoi d'une notification de la division d'examen (délai : M06)
30.08.2010Envoi dune notification signalant que la demande est réputée retirée, motif: {0}
05.11.2010Réponse à une notification de la division dexamen
06.02.2012Envoi d'une notification de la division d'examen (délai : M04)
14.06.2012Réponse à une notification de la division dexamen
09.07.2012Notification relative à l'intention de délivrer le brevet
07.11.2012Taxe de délivrance payée
07.11.2012Taxe publication/d‘impression payée
Demande(s) divisionnaire(s)La date de la première notification de la division d'examen relative à la demande la plus ancienne pour laquelle une notification a été émise est  11.01.2010
Opposition(s)20.09.2013Aucune opposition formée dans le délai imparti [2013/48]
Requête en poursuite de la procédure de:La demande est réputée retirée pour défaut de réponse au rapport dexamen
05.11.2010Requête en poursuite de la procédure déposée
05.11.2010Taxe intégralement payée (date de paiement)
Requête accordée
17.11.2010Décision envoyée
Taxes payéesTaxe annuelle
26.03.2004Taxe annuelle Année du brevet 03
18.03.2005Taxe annuelle Année du brevet 04
31.03.2006Taxe annuelle Année du brevet 05
02.04.2007Taxe annuelle Année du brevet 06
31.03.2008Taxe annuelle Année du brevet 07
31.03.2009Taxe annuelle Année du brevet 08
31.03.2010Taxe annuelle Année du brevet 09
31.03.2011Taxe annuelle Année du brevet 10
31.03.2012Taxe annuelle Année du brevet 11
Dérogation à la compétence  Tooltip
exclusive de la juridiction
unifiée du brevet
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Extinctions durant la phase d’opposition  TooltipIT19.12.2012
NL19.12.2012
[2014/03]
Précédent [2013/37]NL19.12.2012
Citations:Recherche[A]US5519811  (YONEDA HIDEKI [US], et al) [A] 1-71 * the whole document *;
 [A]  - B. SHI, "Focal plane implementation of 2D steerable and scalable Gabor-type filters", JOURNAL OF VLSI SIGNAL PROCESSING, (1999), vol. 23, pages 319 - 334, XP002449041 [A] 1-71 * Section 4. 2D circuit architecture - Section 6.Transistor level circuit implementation *

DOI:   http://dx.doi.org/10.1023/A:1008197102693
 [A]  - C. MEAD AND T. DELBRÜCK, "Scanners for visualizing activity of analog VLSI circuitry", ANALOG INTEGRATED CIRCUITS AND SIGNAL PROCESSING, (1991), vol. 1, pages 93 - 106, XP008083017 [A] 1-71 * the whole document *
 [A]  - BEERHOLD J R ET AL, "Pulse-processing neural net hardware with selectable topology and adaptive weights and delays", PROC. INT. JOINT CONF. ON NEURAL NETWORKS, (19900617), pages 569 - 574, XP010006799 [A] 1-71 * the whole document *
par le demandeurUS5519811
 JP2741793B
 JP2000181487
    - B. SHI, "Focal plane implementation of 2D steerable and scalable Gabor-type filters", JOURNAL OF VLSI SIGNAL PROCESSING, (1999), vol. 23, pages 319 - 334
    - C. MEAD; T. DEIBRUCK, "Scanners for visualizing activity of analog VLSI circuitry", ANALOG INTEGRATED CIRCUITS AND SIGNAL PROCESSING, (1991), vol. 1, pages 93 - 106
    - BEERHOLD J R ET AL., "Pulse-processing neural net hardware with selectable topology and adaptive weights and delays", PROC. INT. JOINT CONF. ON NEURAL NETWORKS, (19900617), pages 569 - 574
    - IEEE TRANS. ON NEURAL NETWORKS, vol. 10, page 540
    - TOMITA, Parallel Computer Configuration Theory, SHOKODO, (1986), pages 190 - 192
    - S.Y. KUNG, Digital Neural Networks, PTR PRENTICE HALL, (1993), pages 340 - 361
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