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Extract from the Register of European Patents

EP About this file: EP2386962

EP2386962 - Programmable queue structures for multiprocessors [Right-click to bookmark this link]
StatusNo opposition filed within time limit
Status updated on  06.02.2015
Database last updated on 19.10.2024
Most recent event   Tooltip12.10.2018Lapse of the patent in a contracting state
New state(s): AL
published on 14.11.2018  [2018/46]
Applicant(s)For all designated states
Telefonaktiebolaget LM Ericsson (publ)
164 83 Stockholm / SE
[N/P]
Former [2011/46]For all designated states
Telefonaktiebolaget L M Ericsson (Publ)
164 83 Stockholm / SE
Inventor(s)01 / Gewirtz, Evan
2687 Paige Way
San Ramon, CA 94582 / US
02 / Hathaway, Robert
788 Grape Avenue
Sunnyvale, CA 94087 / US
03 / Meier, Stephan
2130 Via Escalera
Los Altos, CA 94024 / US
 [2011/46]
Representative(s)Rees, Simon John Lewis
Haseltine Lake LLP
Redcliff Quay
120 Redcliff Street
Bristol BS1 6HU / GB
[2014/14]
Former [2011/46]Rees, Simon John Lewis
Haseltine Lake LLP Redcliff Quay 120 Redcliff Street
Bristol, Avon BS1 6HU / GB
Application number, filing date11164626.103.05.2011
[2011/46]
Priority number, dateUS2010077708410.05.2010         Original published format: US 777084
[2011/46]
Filing languageEN
Procedural languageEN
PublicationType: A1 Application with search report 
No.:EP2386962
Date:16.11.2011
Language:EN
[2011/46]
Type: B1 Patent specification 
No.:EP2386962
Date:02.04.2014
Language:EN
[2014/14]
Search report(s)(Supplementary) European search report - dispatched on:EP30.09.2011
ClassificationIPC:G06F15/167
[2011/46]
CPC:
G06F9/544 (EP,US); G06F9/52 (EP,US)
Designated contracting statesAL,   AT,   BE,   BG,   CH,   CY,   CZ,   DE,   DK,   EE,   ES,   FI,   FR,   GB,   GR,   HR,   HU,   IE,   IS,   IT,   LI,   LT,   LU,   LV,   MC,   MK,   MT,   NL,   NO,   PL,   PT,   RO,   RS,   SE,   SI,   SK,   SM,   TR [2011/46]
TitleGerman:Programmierbare Warteschlangenstrukturen für Multiprozessoren[2011/46]
English:Programmable queue structures for multiprocessors[2011/46]
French:Structures programmables de file d'attente pour multiprocesseurs[2011/46]
Examination procedure04.05.2012Amendment by applicant (claims and/or description)
04.05.2012Examination requested  [2012/24]
11.06.2012Despatch of a communication from the examining division (Time limit: M06)
29.01.2013Despatch of communication that the application is deemed to be withdrawn, reason: reply to the communication from the examining division not received in time
27.03.2013Reply to a communication from the examining division
08.05.2013Despatch of a communication from the examining division (Time limit: M04)
27.08.2013Reply to a communication from the examining division
21.10.2013Communication of intention to grant the patent
17.02.2014Fee for grant paid
17.02.2014Fee for publishing/printing paid
Divisional application(s)The date of the Examining Division's first communication in respect of the earliest application for which a communication has been issued is  11.06.2012
Opposition(s)06.01.2015No opposition filed within time limit [2015/11]
Request for further processing for:The application is deemed to be withdrawn due to failure to reply to the examination report
27.03.2013Request for further processing filed
27.03.2013Full payment received (date of receipt of payment)
Request granted
09.04.2013Decision despatched
Fees paidRenewal fee
28.05.2013Renewal fee patent year 03
Opt-out from the exclusive  Tooltip
competence of the Unified
Patent Court
See the Register of the Unified Patent Court for opt-out data
Responsibility for the accuracy, completeness or quality of the data displayed under the link provided lies entirely with the Unified Patent Court.
Lapses during opposition  TooltipHU03.05.2011
AL02.04.2014
AT02.04.2014
BE02.04.2014
CY02.04.2014
CZ02.04.2014
DK02.04.2014
EE02.04.2014
ES02.04.2014
FI02.04.2014
HR02.04.2014
IT02.04.2014
LT02.04.2014
LV02.04.2014
MC02.04.2014
MK02.04.2014
MT02.04.2014
NL02.04.2014
PL02.04.2014
RO02.04.2014
SE02.04.2014
SI02.04.2014
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SM02.04.2014
TR02.04.2014
IE03.05.2014
LU03.05.2014
CH31.05.2014
LI31.05.2014
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GR03.07.2014
IS02.08.2014
PT04.08.2014
RS19.11.2014
[2018/46]
Former [2018/31]HU03.05.2011
AT02.04.2014
BE02.04.2014
CY02.04.2014
CZ02.04.2014
DK02.04.2014
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ES02.04.2014
FI02.04.2014
HR02.04.2014
IT02.04.2014
LT02.04.2014
LV02.04.2014
MC02.04.2014
MK02.04.2014
MT02.04.2014
NL02.04.2014
PL02.04.2014
RO02.04.2014
SE02.04.2014
SI02.04.2014
SK02.04.2014
SM02.04.2014
TR02.04.2014
IE03.05.2014
LU03.05.2014
CH31.05.2014
LI31.05.2014
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BG02.07.2014
NO02.07.2014
GR03.07.2014
IS02.08.2014
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Former [2016/33]HU03.05.2011
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IT02.04.2014
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LV02.04.2014
MC02.04.2014
MT02.04.2014
NL02.04.2014
PL02.04.2014
RO02.04.2014
SE02.04.2014
SI02.04.2014
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SM02.04.2014
TR02.04.2014
IE03.05.2014
LU03.05.2014
CH31.05.2014
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FR02.06.2014
BG02.07.2014
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IS02.08.2014
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AT02.04.2014
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LI31.05.2014
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NO02.07.2014
GR03.07.2014
IS02.08.2014
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BE02.04.2014
CY02.04.2014
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DK02.04.2014
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BE02.04.2014
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CH31.05.2014
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NO02.07.2014
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PT04.08.2014
RS19.11.2014
Former [2015/21]AT02.04.2014
BE02.04.2014
CY02.04.2014
CZ02.04.2014
DK02.04.2014
EE02.04.2014
ES02.04.2014
FI02.04.2014
HR02.04.2014
IT02.04.2014
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LV02.04.2014
MC02.04.2014
NL02.04.2014
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SE02.04.2014
SK02.04.2014
IE03.05.2014
CH31.05.2014
LI31.05.2014
BG02.07.2014
NO02.07.2014
GR03.07.2014
IS02.08.2014
PT04.08.2014
Former [2015/18]AT02.04.2014
BE02.04.2014
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CZ02.04.2014
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NL02.04.2014
PL02.04.2014
RO02.04.2014
RS02.04.2014
SE02.04.2014
SK02.04.2014
CH31.05.2014
LI31.05.2014
BG02.07.2014
NO02.07.2014
GR03.07.2014
IS02.08.2014
PT04.08.2014
Former [2015/11]AT02.04.2014
BE02.04.2014
CY02.04.2014
CZ02.04.2014
DK02.04.2014
EE02.04.2014
ES02.04.2014
FI02.04.2014
HR02.04.2014
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RS02.04.2014
SE02.04.2014
SK02.04.2014
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NO02.07.2014
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NO02.07.2014
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SE02.04.2014
CH31.05.2014
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CY02.04.2014
CZ02.04.2014
ES02.04.2014
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HR02.04.2014
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LV02.04.2014
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PL02.04.2014
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SE02.04.2014
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NO02.07.2014
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IS02.08.2014
Former [2014/51]AT02.04.2014
CY02.04.2014
CZ02.04.2014
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SE02.04.2014
BG02.07.2014
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Former [2014/50]CY02.04.2014
CZ02.04.2014
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FI02.04.2014
HR02.04.2014
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PL02.04.2014
SE02.04.2014
BG02.07.2014
NO02.07.2014
GR03.07.2014
IS02.08.2014
Former [2014/49]CY02.04.2014
CZ02.04.2014
FI02.04.2014
LT02.04.2014
BG02.07.2014
NO02.07.2014
IS02.08.2014
Former [2014/48]CY02.04.2014
CZ02.04.2014
LT02.04.2014
BG02.07.2014
Former [2014/47]CY02.04.2014
Documents cited:Search[I]  - SU S-C ET AL, "A memory-mapped interprocessor communication architecture using FIFO RAMs", MICROPROCESSING AND MICROPROGRAMMING, ELSEVIER SCIENCE PUBLISHERS, BV., AMSTERDAM, NL, vol. 34, no. 1-5, doi:10.1016/0165-6074(92)90131-P, ISSN 0165-6074, (19920201), pages 187 - 191, (19920201), XP024233494 [I] 1-19 * Sections 1, 2, 3 and 3.1;; figures 3-5 *

DOI:   http://dx.doi.org/10.1016/0165-6074(92)90131-P
 [A]  - MATTHIAS BLUMRICH ET AL, "Virtual-Memory-Mapped Network Interfaces", IEEE MICRO, (19950201), vol. 15, no. 1, doi:10.1109/40.342014, ISSN 0272-1732, pages 21 - 28, XP055007890 [A] 1-19 * Introduction and section titled "SHRIMP -I network interface" *

DOI:   http://dx.doi.org/10.1109/40.342014
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