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EP0140369
Europäisches Verfahren
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Auszug aus dem europäischen Patentregister
EP Übersicht: EP0140369
| EP0140369 - Integrierte Halbleiterschaltung mit in Serien geschalteten Transistoren [Mit Rechtsklick auf diesen Link können Sie ein Bookmark anlegen.] | Status | Anmeldung zurückgenommen Status aktualisiert am 01.09.1987 Datenbank zuletzt aktualisiert am 04.11.2024 | Letztes Ereignis Tooltip | 15.08.2008 | Änderung - Vertreter | veröffentlicht am 17.09.2008 [2008/38] | Anmelder | Für alle benannten Staaten Hitachi, Ltd. 6, Kanda Surugadai 4-chome Chiyoda-ku Tokyo / JP | [N/P] |
| Frühere [1985/19] | Für alle benannten Staaten HITACHI, LTD. 6, Kanda Surugadai 4-chome Chiyoda-ku, Tokyo 100 / JP | Erfinder | 01 /
Kaneko, Kenji 2609-11, Shimokuzawa Sagamihara-shi Kanagawa-ken / JP | 02 /
Nakamura, Tohru 6-6-16-614, Minami-machi Tanashi-shi Tokyo / JP | 03 /
Okabe, Takahiro 2196-36, Hinodemachi Hirai Nishitama-gun Tokyo / JP | 04 /
Nagata, Minoru 1558, Josuihoncho Kodaira-shi Tokyo / JP | [1985/19] | Vertreter | Beetz & Partner mbB Patentanwälte Prinzregentenstraße 54 80538 München / DE | [N/P] |
| Frühere [2008/38] | Beetz & Partner Patentanwälte Steinsdorfstrasse 10 80538 München / DE | ||
| Frühere [1985/19] | Patentanwälte Beetz - Timpe - Siegfried Schmitt-Fumian - Mayr Steinsdorfstrasse 10 D-80538 München / DE | Anmeldenummer, Anmeldetag | 84113062.8 | 30.10.1984 | [1985/19] | Prioritätsnummer, Prioritätstag | JP19830204830 | 02.11.1983 Ursprünglich veröffentlichtes Format: JP 20483083 | [1985/19] | Anmeldesprache | EN | Verfahrenssprache | EN | Veröffentlichung | Art: | A1 Anmeldung mit Recherchenbericht | Nr.: | EP0140369 | Datum: | 08.05.1985 | Sprache: | EN | [1985/19] | Recherchenbericht(e) | (Ergänzender) europäischer Recherchenbericht - versandt am: | EP | 18.03.1985 | Klassifikation | IPC: | H01L27/08 | [1985/19] | CPC: |
H01L27/0828 (EP);
H01L29/70 (KR);
H01L29/7327 (EP)
| Benannte Vertragsstaaten | DE, FR, GB, NL [1985/19] | Bezeichnung der Erfindung | Deutsch: | Integrierte Halbleiterschaltung mit in Serien geschalteten Transistoren | [1985/19] | Englisch: | Semiconductor integrated circuit including series connected transistors | [1985/19] | Französisch: | Circuit intégré semi-conducteur comportant des transistors connectés en série | [1985/19] | Akte vernichtet: | 24.05.1993 | Prüfungsverfahren | 13.05.1985 | Prüfungsantrag gestellt [1985/31] | 17.09.1986 | Absendung einer Mitteilung der Prüfungsabteilung (Frist: M04) | 21.01.1987 | Erwiderung auf eine Mitteilung der Prüfungsabteilung | 04.08.1987 | Absendung der Ankündigung der Erteilung (Einverständnis: ) | 24.08.1987 | Anmeldung vom Anmelder zurückgenommen [1987/43] | Entrichtete Gebühren | Jahresgebühr | 27.10.1986 | Jahresgebühr entrichtet Patentjahr 03 |
| Ausschluss der ausschließlichen Tooltip Zuständigkeit des Einheitlichen Patentgerichts | Zu den entsprechenden Daten siehe das Register des Einheitlichen Patentgerichts | ||
| Die Verantwortung für die Richtigkeit, Vollständigkeit oder Qualität der unter dem Link angezeigten Daten liegt allein beim Einheitlichen Patentgericht. | Angeführte Dokumente: | Recherche | [AD]DE3022565 (HITACHI LTD) | [X] - IBM TECHNICAL DISCLOSURE BULLETIN, vol. 12, no. 9, February 1970, page 1516, New York, US; H.D. VARADARAJAN: "Load impedance for transistor circuit" | [X] - IBM TECHNICAL DISCLOSURE BULLETIN, vol. 14, no. 6, November 1971, page 1684, New York, US; H. FRANTZ et al.: "Monolithic electric circuit" |