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EP About this file: EP2793138

EP2793138 - METHOD AND SYSTEM FOR SINGLE-LINE INTER-INTEGRATED CIRCUIT (I2C) BUS [Right-click to bookmark this link]
Former [2014/43]Method and system for single-line inter-integrated circuit (i2c) bus
[2016/28]
StatusNo opposition filed within time limit
Status updated on  21.07.2017
Database last updated on 02.11.2024
Most recent event   Tooltip06.03.2020Lapse of the patent in a contracting state
New state(s): TR		published on 08.04.2020  [2020/15]
Applicant(s)For all designated states
NXP B.V.
High Tech Campus 60
5656 AG Eindhoven / NL
[2014/43]
Inventor(s)01 / Du, David
c/o NXP B.V., Intellectual Property & Licensing
Red Central
60 High Street
Redhill
Redhill, Surrey RH1 1SH / GB
 [2014/43]
Representative(s)Hardingham, Christopher Mark
NXP Semiconductors
Intellectual Property Group
Abbey House
25 Clarendon Road
Redhill, Surrey RH1 1QZ / GB
[N/P]
Former [2014/43]Hardingham, Christopher Mark
NXP B.V.
Intellectual Property & Licensing
Red Central
60 High Street
Redhill, Surrey RH1 1SH / GB
Application number, filing date14163807.208.04.2014
[2014/43]
Priority number, dateUS20131386356516.04.2013         Original published format: US201313863565
[2014/43]
Filing languageEN
Procedural languageEN
PublicationType: A1 Application with search report 
No.:EP2793138
Date:22.10.2014
Language:EN
[2014/43]
Type: B1 Patent specification 
No.:EP2793138
Date:14.09.2016
Language:EN
[2016/37]
Search report(s)(Supplementary) European search report - dispatched on:EP18.08.2014
ClassificationIPC:G06F13/42
[2014/43]
CPC:
G06F13/362 (EP,US); G06F13/42 (EP,US); G06F13/4295 (EP,US)
Designated contracting statesAL,   AT,   BE,   BG,   CH,   CY,   CZ,   DE,   DK,   EE,   ES,   FI,   FR,   GB,   GR,   HR,   HU,   IE,   IS,   IT,   LI,   LT,   LU,   LV,   MC,   MK,   MT,   NL,   NO,   PL,   PT,   RO,   RS,   SE,   SI,   SK,   SM,   TR [2015/23]
Former [2014/43]AL,  AT,  BE,  BG,  CH,  CY,  CZ,  DE,  DK,  EE,  ES,  FI,  FR,  GB,  GR,  HR,  HU,  IE,  IS,  IT,  LI,  LT,  LU,  LV,  MC,  MK,  MT,  NL,  NO,  PL,  PT,  RO,  RS,  SE,  SI,  SK,  SM,  TR 
TitleGerman:VERFAHREN UND SYSTEM FÜR EINEN EINZEILIGEN I²C-BUS[2016/31]
English:METHOD AND SYSTEM FOR SINGLE-LINE INTER-INTEGRATED CIRCUIT (I2C) BUS[2016/28]
French:PROCÉDÉ ET SYSTÈME POUR BUS (I2C) DE CIRCUIT INTER-INTÉGRÉ MONOLIGNE[2016/31]
Former [2014/43]Verfahren und System für einen einzeiligen I²C-Bus
Former [2014/43]Method and system for single-line inter-integrated circuit (i2c) bus
Former [2014/43]Procédé et système pour bus (i2c) de circuit inter-intégré monoligne
Examination procedure29.09.2014Amendment by applicant (claims and/or description)
22.04.2015Examination requested  [2015/23]
14.03.2016Communication of intention to grant the patent
12.05.2016Disapproval of the communication of intention to grant the patent by the applicant or resumption of examination proceedings by the EPO
04.07.2016Communication of intention to grant the patent
26.07.2016Fee for grant paid
26.07.2016Fee for publishing/printing paid
26.07.2016Receipt of the translation of the claim(s)
Opposition(s)15.06.2017No opposition filed within time limit [2017/34]
Fees paidRenewal fee
02.05.2016Renewal fee patent year 03
Opt-out from the exclusive  Tooltip
competence of the Unified
Patent Court		 See the Register of the Unified Patent Court for opt-out data
Responsibility for the accuracy, completeness or quality of the data displayed under the link provided lies entirely with the Unified Patent Court.
Lapses during opposition  TooltipHU08.04.2014
AL14.09.2016
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FR02.05.2017
[2020/15]
Former [2019/52]HU08.04.2014
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